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Añadiendo funcionalidades a un procesador RISC-V basado en el proyecto RVFPG
dc.contributor.advisor | Villalba-Moreno, Julio | |
dc.contributor.author | Martínez Conejo, Alfonso | |
dc.date.accessioned | 2024-10-01T12:30:19Z | |
dc.date.available | 2024-10-01T12:30:19Z | |
dc.date.issued | 2024-06 | |
dc.identifier.uri | https://hdl.handle.net/10630/34157 | |
dc.description.abstract | Con motivo de la reciente escasez de microchips producida tras la pandemia, en Europa ha surgido la necesidad de contar con una tecnología propia, debido a la suma importancia de este tipo de componentes y a que actualmente tanto el diseño como la producción de microchips se encuentra focalizada en Estados Unidos y China. Es ahí donde cobra importancia RISC-V, una arquitectura de hardware libre, pero cuyo desarrollo e implementación se encuentran aún en una fase algo temprana. El objetivo de este trabajo de fin de grado es estudiar el funcionamiento de la arquitectura RISC-V, para posteriormente añadir nuevas funcionalidades a un procesador de dicha arquitectura, en la forma de instrucciones de manipulación de bits, un contador de eventos hardware y, especialmente, añadiendo soporte para realizar operaciones en punto flotante, lo cual se hará empleando un nuevo formato de representación llamado HUB (Half Unit Biased). Para poder acceder a un procesador y modificarlo, se ha accedido al proyecto RVfpga, desarrollado por Imagination University Programme. | es_ES |
dc.language.iso | spa | es_ES |
dc.rights | Attribution-NonCommercial-NoDerivatives 4.0 Internacional | * |
dc.rights.uri | http://creativecommons.org/licenses/by-nc-nd/4.0/ | * |
dc.subject | Circuitos integrados | es_ES |
dc.subject | Microelectrónica | es_ES |
dc.subject | E.T.S.I. Informática - Trabajos Fin de Grado | es_ES |
dc.subject | Grado en Ingeniería de Computadores - Trabajos Fin de Grado | es_ES |
dc.subject.other | RISC-V | es_ES |
dc.subject.other | Punto Flotante | es_ES |
dc.subject.other | FPGA | es_ES |
dc.subject.other | Formato HUB | es_ES |
dc.subject.other | ISA 3 | es_ES |
dc.title | Añadiendo funcionalidades a un procesador RISC-V basado en el proyecto RVFPG | es_ES |
dc.title.alternative | Adding functionalities to a RISC-V CPU based on the RVFPGA project | es_ES |
dc.type | bachelor thesis | es_ES |
dc.centro | E.T.S.I. Informática | es_ES |
dc.departamento | Arquitectura de Computadores | |
dc.rights.accessRights | open access | es_ES |